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Fig. 2 Data input timing chart
CP1
CP2
DU3
240 637
1
1
1
5
1 637
2
1
2 637
Invalid
Invalid
DU2
240 638
1
2
1
6
1 638
2
2
2 638
Invalid
Invalid
DU1
240 639
1
3
1
7
1 639
2
3
2 639
Invalid
Invalid
DU0
240 640
1
4
1
8
1 640
2
4
2 640
Invalid
Invalid
DL3
480 637
241
1
5
637
242
1
637
Invalid
Invalid
241
241
242
DL2
480 638
241
2
6
638
242
2
638
Invalid
Invalid
241
241
242
DL1
480 639
241
3
7
639
242
3
639
Invalid
Invalid
241
241
242
DL0
480 640
241
4
8
640
242
4
640
Invalid
Invalid
241
241
242
S
DU0 ~ 3
1 (1 ~ 640)
CP1
240 (1 ~ 640)
1 (1 ~ 640)
DL0 ~ 3
241 (1 ~ 640)
480 (1 ~ 640)
(1 ~ 640)
CP2 X 640/4 pulses
S
CP1 X 200 pulses
241
Reduction
– 80 –
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