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AR-NB2
CIRCUIT DIAGRAM
7 – 15
<SDRAM>
<ADDRESS/DATA>
<FLASH>
<PCI>
SDDQM0
SDDQM5
SDDQM7
SDDQM6
SDDQM4
SDDQM1
SDDQM3
SDDQM2
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
TP32
TP12
TP21
TP34
TP15
ICT29
ICT24
TP22
TP35
ICT30
TP38
TP23
TP10
ICT9
ICT10
TP33
ICT11
ICT12
TP13
ICT15
ICT13
ICT16
TP16
ICT14
TP24
TP36
TP39
ICT1
TP37
TP40
ICT2
TP41
TP25
TP11
ICT25
TP42
ICT3
ICT19
TP27
ICT4
TP14
TP43
ICT21
TP45
ICT26
ICT22
TP28
TP44
ICT17
TP17
ICT18
TP26
ICT20
ICT27
TP31
TP18
TP30
ICT5
TP19
ICT6
TP29
ICT28
ICT7
ICT23
ICT8
TP20
VCCINT
SDDQM[7:0]
3,5
SDWE
3,5
SDRCS2
3,5
SDCAS
3,5
SDRAS
3,5
SDCKE
3,5
SDRCS0
3,5
SDRCS1
3,5
ROMWE
3,6
ROMOE
3,6
MEMDIR
3,6
ALE
3,6
FOE
6,7
FWE
6,7
PONRST
2,7,9,10,11,13
ROMCS2
3,7
ROMCS3
3,7
ROMCS0
3,7
ROMCS1
3,7
PCIREQ0
4,11
PCIREQ1
4,10
PCIREQ2
4,9
PCIGNT0
4,11
PCIGNT1
4,10
PCIGNT2
4,9
SYSCLK
3
ROMCS4
3,7
FONT_OE
6,7
FONT_WE
6,7
ALE
3,6
DM1
11,12
DP1
11,12
MEMDIR
3,6
PCIGNT0
4,11
PCIGNT1
4,10
PCIREQ1
4,10
PCIREQ0
4,11
ROMCS1
3,7
ROMOE
3,6
SDCAS
3,5
ROMWE
3,6
SDDQM2
3,5
SDDQM0
3,5
SDCKE
3,5
SDDQM1
3,5
SDRAS
3,5
SDDQM7
3,5
SDDQM4
3,5
SDRCS1
3,5
SDDQM5
3,5
SDRCS0
3,5
SDDQM6
3,5
SDDQM3
3,5
SDRCS2
3,5
SDWE
3,5
SYSCLK
3
DM2
11,12
DP2
11,12
A
B
C
D
8765
4
3
1
2
3
4
5
6
7
8
D
C
B
A
A
B
C
D
8765
4
3
1
1
2
2
3
4
5
6
7
8
D
C
B
A
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